José Carlos Alves Pereira Monteiro


AuthID: R-000-85F

Publicações Confirmadas: 98



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TÍTULO: Generating Worst-Case Stimuli for Accurate Power Grid Analysis
AUTORES: Pedro Marques Morgado; Paulo F Flores ; Jose C Monteiro ; Silveira, L. Miguel ;
PUBLICAÇÃO: 2009, FONTE: 18th International Workshop on Power and Timing Modeling, Optimization and Simulation (PATMOS) in INTEGRATED CIRCUIT AND SYSTEMS DESIGN: POWER AND TIMING MODELING, OPTIMIZATION AND SIMULATION, VOLUME: 5349
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TÍTULO: Parameter Timing in SVM-Based Power Macro-Modeling
AUTORES: Antonio Gusmao; Silveira, L. Miguel ; Jose Monteiro ;
PUBLICAÇÃO: 2009, FONTE: 10th International Symposium on Quality Electronic Design in ISQED 2009: PROCEEDINGS 10TH INTERNATIONAL SYMPOSIUM ON QUALITY ELECTRONIC DESIGN, VOLS 1 AND 2
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TÍTULO: Power and Delay Comparison of Binary and Quaternary Arithmetic Circuits
AUTORES: Cristiano Lazzari; Paulo Flores ; Jose Carlos Monteiro ;
PUBLICAÇÃO: 2009, FONTE: 3rd International Conference on Signals, Circuits and Systems in 2009 3RD INTERNATIONAL CONFERENCE ON SIGNALS, CIRCUITS AND SYSTEMS (SCS 2009)
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TÍTULO: Computation of the minimal set of paths for observability-based statement coverage
AUTORES: Costa, J; Monteiro, J ;
PUBLICAÇÃO: 2008, FONTE: 15th International Conference on Mixed Design of Integrated Circuits and Systems, MIXDES 2008 in Proceedings of The 15th International Conference Mixed Design of Integrated Circuits and Systems, MIXDES 2008
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TÍTULO: Efficient dedicated multiplication blocks for 2's complement radix-16 and radix-256 array multipliers
AUTORES: Pieper, LZ; Da Costa, EAC; De Almeida, SJM; Bampi, S; Monteiro, JC ;
PUBLICAÇÃO: 2008, FONTE: 2008 2nd International Conference on Signals, Circuits and Systems, SCS 2008 in 2008 2nd International Conference on Signals, Circuits and Systems, SCS 2008
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56
TÍTULO: Exact and approximate algorithms for the optimization of area and delay in multiple constant multiplications  Full Text
AUTORES: Levent Aksoy ; Eduardo Da Costa; Paulo Flores ; Jose Monteiro ;
PUBLICAÇÃO: 2008, FONTE: IEEE TRANSACTIONS ON COMPUTER-AIDED DESIGN OF INTEGRATED CIRCUITS AND SYSTEMS, VOLUME: 27, NÚMERO: 6
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TÍTULO: A comparison of layout implementations of pipelined and non-pipelined signed radix-4 array multiplier and modified booth multiplier architectures
AUTORES: de Oliveira, LL; Santos, C; Ferrao, D; Costa, E; Monteiro, J ; Martins, JB; Bampi, S; Reis, R;
PUBLICAÇÃO: 2007, FONTE: IFIP International Federation for Information Processing, VOLUME: 240
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TÍTULO: A new array architecture for signed multiplication using Gray encoded radix-2(m) operands  Full Text
AUTORES: da Costa, E; Monteiro, J ; Bampi, S;
PUBLICAÇÃO: 2007, FONTE: INTEGRATION-THE VLSI JOURNAL, VOLUME: 40, NÚMERO: 2
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TÍTULO: Effect of number representation on the achievable minimum number of operations in multiple constant multiplications  Full Text
AUTORES: Levent Aksoy ; Ece Cay Gunes; Eduardo Costa; Paulo Flores ; Jose Monteiro ;
PUBLICAÇÃO: 2007, FONTE: IEEE Workshop on Signal Processing Systems in 2007 IEEE WORKSHOP ON SIGNAL PROCESSING SYSTEMS, VOLS 1 AND 2
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TÍTULO: Minimum number of operations under a general number representation for digital filter synthesis
AUTORES: Levent Aksoy ; Eduardo Costa; Paulo Flores ; Jose Monteiro ;
PUBLICAÇÃO: 2007, FONTE: 18th European Conference on Circuit Theory Design in 2007 EUROPEAN CONFERENCE ON CIRCUIT THEORY AND DESIGN, VOLS 1-3
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