41
TÍTULO: Retiming sequential circuits for low power
AUTORES: Monteiro, J; Devadas, S; Ghosh, A;
PUBLICAÇÃO: 2002, FONTE: Proceedings of 1993 International Conference on Computer Aided Design (ICCAD)
INDEXADO EM: CrossRef: 92
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42
TÍTULO: Probabilistic bottom-up RTL power estimation
AUTORES: Ferreira, R; A.-M Trullemans; Costa, J; Monteiro, J;
PUBLICAÇÃO: 2002, FONTE: Proceedings IEEE 2000 First International Symposium on Quality Electronic Design (Cat. No. PR00525)
INDEXADO EM: CrossRef
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43
TÍTULO: Power efficient arithmetic operand encoding [CMOS circuits]
AUTORES: Costa, E; Bampi, S; Monteiro, J;
PUBLICAÇÃO: 2001, FONTE: 14th Symposium on Integrated Circuits and Systems Design, SBCCI 2001 in Proceedings - 14th Symposium on Integrated Circuits and Systems Design, SBCCI 2001
INDEXADO EM: Scopus CrossRef
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44
TÍTULO: Power optimized Viterbi decoder implementation through architectural transforms
AUTORES: Portela, J; Monteiro, J;
PUBLICAÇÃO: 2001, FONTE: 14th Symposium on Integrated Circuits and Systems Design, SBCCI 2001 in Proceedings - 14th Symposium on Integrated Circuits and Systems Design, SBCCI 2001
INDEXADO EM: Scopus CrossRef
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45
TÍTULO: A probabilistic approach for RT-level power modeling
AUTORES: Costa, J; Monteiro, J; Silveira, L. Miguel ; Devadas, S;
PUBLICAÇÃO: 1999, FONTE: 6th IEEE International Conference on Electronics, Circuits and Systems, ICECS 1999 in Proceedings of the IEEE International Conference on Electronics, Circuits, and Systems, VOLUME: 2
INDEXADO EM: Scopus CrossRef
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46
TÍTULO: Computer-Aided Design Techniques for Low Power Sequential Logic Circuits
AUTORES: José Monteiro; Srinivas Devadas;
PUBLICAÇÃO: 1997
INDEXADO EM: CrossRef Openlibrary
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47
TÍTULO: Power estimation methods for sequential logic circuits  Full Text
AUTORES: Chi-Ying Tsui, ; Monteiro, J; Massoud Pedram, ; Srinivas Devadas, ; A.M Despain; Lin, B;
PUBLICAÇÃO: 1995, FONTE: IEEE Transactions on Very Large Scale Integration (VLSI) Systems - IEEE Trans. VLSI Syst., VOLUME: 3, NÚMERO: 3
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