Horácio Cláudio de Campos Neto


AuthID: R-000-5ZS

Publicações Confirmadas: 40



1
TÍTULO: Design of a Massively Parallel Computing Architecture for Dense Matrix Multiplication
AUTORES: Wilson Jose; Ana Rita Silva; Mario Vestias ; Horacio Neto ;
PUBLICAÇÃO: 2013, FONTE: IEEE 4th Latin American Symposium on Circuits and Systems (LASCAS) in 2013 IEEE 4TH LATIN AMERICAN SYMPOSIUM ON CIRCUITS AND SYSTEMS (LASCAS)
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2
TÍTULO: Design of a Multiband Full-Rate Ultra-Wideband Receiver in FPGA
AUTORES: Mario Vestias ; Horacio Neto ; Helena Sarmento ;
PUBLICAÇÃO: 2013, FONTE: IEEE 4th Latin American Symposium on Circuits and Systems (LASCAS) in 2013 IEEE 4TH LATIN AMERICAN SYMPOSIUM ON CIRCUITS AND SYSTEMS (LASCAS)
INDEXADO EM: Scopus WOS CrossRef
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3
TÍTULO: A High-Performance Reconfigurable Computing Architecture using a Magnetic Configuration Memory
AUTORES: Victor Silva; Jorge R Fernandes ; Mario P Vestias ; Horacio C Neto ;
PUBLICAÇÃO: 2012, FONTE: International Conference on Reconfigurable Computing and FPGAs (ReConFig) in 2012 INTERNATIONAL CONFERENCE ON RECONFIGURABLE COMPUTING AND FPGAS (RECONFIG)
INDEXADO EM: Scopus WOS CrossRef
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4
TÍTULO: Design of high-speed viterbi decoders on virtex-6 FPGAs
AUTORES: Vestias, M ; Neto, H ; Sarmento, H ;
PUBLICAÇÃO: 2012, FONTE: 15th Euromicro Conference on Digital System Design, DSD 2012 in Proceedings - 15th Euromicro Conference on Digital System Design, DSD 2012
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5
TÍTULO: Non-volatile memory circuits for FIMS and TAS writing techniques on magnetic tunnelling junctions
AUTORES: Silva, V; Vestias, MP ; Neto, HC ; Fernandes, JR ;
PUBLICAÇÃO: 2012, FONTE: 2012 19th IEEE International Conference on Electronics, Circuits, and Systems, ICECS 2012 in 2012 19th IEEE International Conference on Electronics, Circuits, and Systems, ICECS 2012
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6
TÍTULO: Parallel decimal multipliers and squarers using Karatsuba-Ofman's algorithm
AUTORES: Vestias, M ; Neto, H ;
PUBLICAÇÃO: 2012, FONTE: 15th Euromicro Conference on Digital System Design, DSD 2012 in Proceedings - 15th Euromicro Conference on Digital System Design, DSD 2012
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7
TÍTULO: Sliding block Viterbi decoders in FPGA
AUTORES: Vestias, M ; Neto, H ; Sarmento, H ;
PUBLICAÇÃO: 2012, FONTE: 22nd International Conference on Field Programmable Logic and Applications, FPL 2012 in Proceedings - 22nd International Conference on Field Programmable Logic and Applications, FPL 2012
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8
TÍTULO: A dynamic buffer resize technique for networks-on-chip on FPGA
AUTORES: Vestias, MP ; Neto, HC ;
PUBLICAÇÃO: 2011, FONTE: 2011 7th Southern Conference on Programmable Logic, SPL 2011 in Proceedings of the 2011 7th Southern Conference on Programmable Logic, SPL 2011
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9
TÍTULO: Iterative decimal multiplication using binary arithmetic
AUTORES: Vestias, MP ; Neto, HC ;
PUBLICAÇÃO: 2011, FONTE: 2011 7th Southern Conference on Programmable Logic, SPL 2011 in Proceedings of the 2011 7th Southern Conference on Programmable Logic, SPL 2011
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10
TÍTULO: Revisiting the Newton-Raphson iterative method for decimal division
AUTORES: Vestias, MP ; Neto, HC ;
PUBLICAÇÃO: 2011, FONTE: 21st International Conference on Field Programmable Logic and Applications, FPL 2011 in Proceedings - 21st International Conference on Field Programmable Logic and Applications, FPL 2011
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